Exercices corrigés (Microprocesseur et mémoires)
I. Présentation du sujet. L'apprentissage de la ... Développé en 1978 par Intel, le
microprocesseur 8086 est un processeur CISC 16 bits. Il s'agit du premier ...
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1) Architecture généraleQuestion 1 : Complétez les schéma de la machine de von Neuman suivant :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF09qs9LHI/AAAAAAAABM8/9rP-ae5HQt0/s1600/afoexam1.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF09qs9LHI/AAAAAAAABM8/9rP-ae5HQt0/s1600/afoexam1.PNG" \* MERGEFORMATINET
Question 2 : Complétez le schéma du PC suivant :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1CML2kkI/AAAAAAAABNA/woYWwS5AWas/s1600/afoexam2.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1CML2kkI/AAAAAAAABNA/woYWwS5AWas/s320/afoexam2.PNG" \* MERGEFORMATINET
Question 3 : Identifiez les composants sur la carte mère suivante :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1L7J6Y4I/AAAAAAAABNE/cnsLZPh1q4o/s1600/afoexam3.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1L7J6Y4I/AAAAAAAABNE/cnsLZPh1q4o/s400/afoexam3.PNG" \* MERGEFORMATINET
2 ) BusQuestion 4 : Bus mémoire. Calculez les taux de transferts suivants :
HYPERLINK "http://2.bp.blogspot.com/_LxUaQO3IvbY/TMF1UOoNLYI/AAAAAAAABNI/OJfJ_t8gaNE/s1600/afoexam4.PNG" INCLUDEPICTURE "http://2.bp.blogspot.com/_LxUaQO3IvbY/TMF1UOoNLYI/AAAAAAAABNI/OJfJ_t8gaNE/s400/afoexam4.PNG" \* MERGEFORMATINET
Question 5 : Bus périphérique. Calculez les taux de transferts suivants :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1YEHpMPI/AAAAAAAABNM/CVu29rAkrW4/s1600/afoexam5.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF1YEHpMPI/AAAAAAAABNM/CVu29rAkrW4/s400/afoexam5.PNG" \* MERGEFORMATINET
3) Processeur
Question 6 : Sachant que le bus dadresse du processeur est de 16 bits avec un alignement à loctet, quelle est la taille de lespace mémoire maximum que celui-ci peut adresser ? Quelles solutions existent pour adresser une plus grande zone mémoire ?
Question 7 : Où sont effectués les calculs ?Question 8 : A quoi servent les registres suivants du processeur :i. PC/IP (ou CO/PI)ii. IR (ou RI)iii. SP (ou PP)iv. AccumulateurQuestion 9 : Quelle tâche réalise le séquenceur dans un processeur ? LOrdonnanceur ?4 ) Mémoires
Question 10 : Quelles sont les principales différences entre la DRAM et la SRAM ? Où utilise-t-on de la DRAM ? De la SRAM ?Question 11 : Quelles sont les principales différences entre la RAM et la ROM ? Où utilise-t-on de la ROM ?
Question 12 : Quest-ce que le shadowing ?Question 13 : Classez les mémoires suivantes par taille, par rapidité : RAM, registres, disques durs, cache L1, cache L2, cd-rom.Question 14 : Quels sont les propriétés des disques RAIDs ? Comment les obtient-on ?5 ) Mémoire cacheQuestion 15 : Pourquoi utilise-t-on des mémoires caches ?Soit une mémoire cache de niveau L1 ayant les caractéristiques suivantes :
- 32 mots par lignes (mots de 2 octets)- Taille de 32ko- L1 et L2 sont inclusifs- 4-associatifs. Remplacement LRU.- Association par poids faible- Taille de bus dadresse : 32bitsQuestion 16 : Combien y a-t-il de lignes dans cette mémoire cache ?Question 17 : Combien y a t-il de blocs associatifs dans cette mémoire cache ?Question 18 : Si la mémoire cache de niveau L2 a une taille de 2 Mo, combien y a-t-il de blocs de la mémoire cache L2 par bloc de la mémoire cache L1 ?
Question 19 : Si la mémoire fait 1Go, combien dadresses correspondront à un bloc du cache L1 ?
Question 20 : Dans quelles blocs du cache peut-on trouver les blocs suivants :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF2G7DY9wI/AAAAAAAABNQ/JoHNtsXA1KI/s1600/afoexam6.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF2G7DY9wI/AAAAAAAABNQ/JoHNtsXA1KI/s400/afoexam6.PNG" \* MERGEFORMATINET
Question 21 : Si un bloc nest pas présent en cache L1, combien de lignes de L1 aura-t-on parcouru ?Question 22 : Quelle est la probabilité de trouver un bloc quelconque présent dans L2 dans la cache L1 ?
- Si L1 et L2 sont des caches inclusives.- Si L1 et L2 sont des caches exclusives.Question 23 : Dans cet exercice, on considère quil ny a que 64 blocs de cache L1.
Les quatre premiers blocs de la cache L1 sont remplis comme suit :
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HYPERLINK "http://3.bp.blogspot.com/_LxUaQO3IvbY/TMF2PzjaHvI/AAAAAAAABNY/auZb4QOgoCw/s1600/afoexam8.PNG" INCLUDEPICTURE "http://3.bp.blogspot.com/_LxUaQO3IvbY/TMF2PzjaHvI/AAAAAAAABNY/auZb4QOgoCw/s400/afoexam8.PNG" \* MERGEFORMATINET
Les lignes dadresses suivantes sont lues dans lordre : 08012000h, 08012040h, 08020080h, 080220C0h,08012080h, 080120C0h, 080220C0h, 080520C0h, 08022080h, 08021080h, 08012800h, 08012840h, 08012880h, 080128C0h. Donnez létat du cache après ces lectures. HYPERLINK "http://2.bp.blogspot.com/_LxUaQO3IvbY/TMF2UTh1mwI/AAAAAAAABNc/i35aAw1efmE/s1600/afoexam9.PNG" INCLUDEPICTURE "http://2.bp.blogspot.com/_LxUaQO3IvbY/TMF2UTh1mwI/AAAAAAAABNc/i35aAw1efmE/s400/afoexam9.PNG" \* MERGEFORMATINET
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF2XMp8lBI/AAAAAAAABNg/5h0Faa776bI/s1600/afoexam10.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF2XMp8lBI/AAAAAAAABNg/5h0Faa776bI/s400/afoexam10.PNG" \* MERGEFORMATINET
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Correction
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Question 1 :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF8UBz9uiI/AAAAAAAABNk/43FTJctmIAY/s1600/afoexamco1.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF8UBz9uiI/AAAAAAAABNk/43FTJctmIAY/s320/afoexamco1.PNG" \* MERGEFORMATINET
Question 2 :
HYPERLINK "http://4.bp.blogspot.com/_LxUaQO3IvbY/TMF8YGApdDI/AAAAAAAABNo/5P8XpJjaPZs/s1600/afoexamco2.PNG" INCLUDEPICTURE "http://4.bp.blogspot.com/_LxUaQO3IvbY/TMF8YGApdDI/AAAAAAAABNo/5P8XpJjaPZs/s320/afoexamco2.PNG" \* MERGEFORMATINET
Question 3 :1. Slots RAM (DIMM)2. Socket CPU (Socket 939 pour AMD64)3. Connecteur de lecteur de disquette4. Connecteurs IDE5. Chipset (NVIDIA nForce3 - Chipset non décomposé en NorthBridge et SouthBridge)6. Slots PCI7. Slot AGP8. Connecteurs dextensions (Son/LAN/USB/Parallèle/Série/Souris/Clavier)Question 4 :
HYPERLINK "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF8cGMS35I/AAAAAAAABNs/IwN76Iw8Upo/s1600/afoexamco3.PNG" INCLUDEPICTURE "http://1.bp.blogspot.com/_LxUaQO3IvbY/TMF8cGMS35I/AAAAAAAABNs/IwN76Iw8Upo/s400/afoexamco3.PNG" \* MERGEFORMATINET
Question 5 :
HYPERLINK "http://3.bp.blogspot.com/_LxUaQO3IvbY/TMF8f-q_qVI/AAAAAAAABNw/PMvSH_-YCiU/s1600/afoexamco4.PNG" INCLUDEPICTURE "http://3.bp.blogspot.com/_LxUaQO3IvbY/TMF8f-q_qVI/AAAAAAAABNw/PMvSH_-YCiU/s400/afoexamco4.PNG" \* MERGEFORMATINET
Question 6 :- 216 = 65536 = 64ko- Les solutions : utiliser un oûset de pagination ou augmenter la taille du bus mémoireQuestion 7 :Dans l UAL (l Unité Arithmétique et Logique)Question 8 :
i. Le Program Counter/Instruction Pointer (Comteur Ordinal/Pointeur d instruction) pointe vers l instruction à exécuter
ii. Le registre dinstruction (Instruction Register) contient linstruction en cours dexécution
iii. Le pointeur de pile (Stack Pointer) pointe le sommet de la pile (expliquer ce quest une pile).
iv. Laccumulateur stocke le résultat de lALU.
Question 9 : Le séquenceur exécute linstruction en commandant les différente partie du processeur.Lordonnanceur réordonnance les instructions pour optimiser lusage du processeur.Question 10 :
La DRAM (Dynamic RAM) est basée sur des condensateurs quil faut rafraichir alors que la SRAM est bas´e des interrupteurs qu il suût d alimenter. Ce temps de rafraichissement font que la DRAM est plus lente que la SRAM mais est moins couteuse car utilise moins de transistors.Ce sont toutes les deux des mémoires volatiles.La SRAM plus cher mais plus rapide est utilisé dans les mémoires caches alors que la DRAM est utilisé dans la mémoire centrale.
Question 11 :
RAM est en lecture/écriture mais volatile alors la ROM est en lecture seule et non-volatile. On utilise en générale de la ROM pour les données du BIOS pour le démarrage de la machine.
Question 12 :
Il sagit du fait de copier le contenu de la ROM en RAM pour accélérer laccès à la ROM qui est très lent. Il sagit dune technique de cache.
Question 13 : Par taille : Registres < L1 < L2 < RAM < CD < DD.Par vitesse : Registres > L1 > L2 > RAM > DD > CD.Question 14 :
Tolérance aux pannes et rapidité obtenu par la cumulation de plusieurs disques (parallélisation de la lecture et de lécriture + redondance de linformation).
Question 15 :
Pour accélérer laccès aux données en rapprochant les données du processeur et sur des mémoires plus rapide mais plus coûteuse.
Question 16 :
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Question 17 :
HYPERLINK "http://4.bp.blogspot.com/_LxUaQO3IvbY/TMF8uZDAbSI/AAAAAAAABN4/b4QcwEtFgTo/s1600/afoexamco6.PNG" INCLUDEPICTURE "http://4.bp.blogspot.com/_LxUaQO3IvbY/TMF8uZDAbSI/AAAAAAAABN4/b4QcwEtFgTo/s1600/afoexamco6.PNG" \* MERGEFORMATINET
Question 18 :
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Question 19 :
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Question 20 :
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Il sagit dune division par 64 (décalage de 6 bits pour les 64 octets dune ligne) et dun modulo 128 (and 80h).Question 21 : 4Question 22 :
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Question 23 :
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